LDO的應(yīng)用非常簡單,很多LDO僅需在輸入端及輸出端各接一顆電容即可穩(wěn)定工作。
在LDO的應(yīng)用中需要考慮壓差、靜態(tài)電流、PSRR等重要參數(shù)。在以電池作為電源的系統(tǒng)中,應(yīng)當(dāng)選擇壓差盡量低的LDO,這樣可以使電池較長時間為系統(tǒng)供電,比如NCP600,NCP629等等。
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詞條說明
【LDO廠家】LDO低壓差線性穩(wěn)壓器的結(jié)構(gòu)
LDO即low dropout regulator,是一種低壓差線性穩(wěn)壓器。這是相對于傳統(tǒng)的線性穩(wěn)壓器來說的。傳統(tǒng)的線性穩(wěn)壓器,如78XX系列的芯片都要求輸入電壓要比輸出電壓至少高出2V~3V,否則就不能正常工作。但是在一些情況下,這樣的條件顯然是太苛刻了,如5V轉(zhuǎn)3.3V,輸入與輸出之間的壓差只有1.7v,顯然這是不滿足傳統(tǒng)線性穩(wěn)壓器的工作條件的。針對這種情況,芯片制造商們才研發(fā)出了LDO類的電
FPGA(Field Programmable Gate Array)是在PAL、GAL等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為**集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。FPGA 器件屬于**集成電路中的一種半定制電路,是可編程的邏輯列陣,能夠有效的解決原有的器件門電路數(shù)較少的問題。FPGA 的基本結(jié)構(gòu)包括可編程
FPGA (Field-Program? ble Gate Array),中文全名當(dāng)場可編程門陣列,究竟是什么?本體是一種數(shù)字集成電路,一個可以根據(jù)程序編寫來更改內(nèi)部構(gòu)造的集成ic。FPGA < PLD (可編程邏輯性元器件)< ASIC (**型電子器件)小于號表明非空子集關(guān)聯(lián)。較先大家得從ASIC的談起,就是指應(yīng)特殊客戶規(guī)定而設(shè)計方案的電子器件,徹底的人性化,無論是用以智
FPGA采用了邏輯單元陣列LCA(Logic Cell Array)這樣一個概念,內(nèi)部包括可配置邏輯模塊CLB(Configurable Logic Block)、輸入輸出模塊IOB(Input Output Block)和內(nèi)部連線(Interconnect)三個部分。?現(xiàn)場可編程門陣列(FPGA)是可編程器件,與傳統(tǒng)邏輯電路和門陣列(如PAL,GAL及CPLD器件)相比,F(xiàn)PGA具有不
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